东大计算机硬件技术基础期末考试复习资料与参考答案

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广东开放大学 2023年春季招生简章

计算机硬件技术基础复习题

单选题

若“与非”门输入为A和B，只有当B分别为_________时，输出Y=0。

A 0，1

B 0，0

C 1，0

( )1，1

若一台计算机的字长为4个字节，这意味着它

A 在CPU中运行的结果最大为2的32次方

B 在CPU中处理传送的数据为32位

C 能处理的数值最大为4位十进制数9999

( )能处理的字符串最多为4个英文字母组成

使用计算机时，突然断电，存储在下列设备中的信息将丢失的是

A U盘

B ROM

C RAM

( )硬盘

通常说16位主存储器容量为64kB，表示主存储器的存储空间有

A 10241024Bye

B 161024Bye

C 1601024Bye

( )641024Bye

完整的冯.诺依曼结构的计算机硬件包括

A CP内键显示器

B CP内磁显示器

C CP存储键显示器

( ) CP存储输入设输出设备

微型计算机系统中的字长是由 的宽度决定的。

A 系统总线

B 控制总线

C 数据总线

( ) 地址总线

微型计算机系统中对内存的寻址空间是由______的宽度决定的。

A 地址总线

B 系统总线

C 数据总线

( ) 控制总线

下列4种不同进制的无符号数中最小的数是

A 11011001B

B 75

C 37(八进制数)

( ) 2AH

下列哪条指令可以使AL中的最高位置1

A AN( ) AL，80H

B XOR AL，80H

C OR AL，80H

( ) ES AL，80H

下列哪一项代表CPU的执行速度

A MHz

B CPS

C LPM

( ) MByes

下列数据中有可能是八进制数的是

A 379

B 283

C 488

( ) 477

下列说法正确的是

A 静态RA动态RAM都属易失性存储器，前者在电源不掉时，不易失

B 半导体RAM信息可读可写，且断电后仍能保持记忆

C 半导体RAM属易失性存储器，而静态RAM的存储信息是不易失的

( ) 静态RAM不用刷新，且集成度比动态RAM高，所以计算机系统上常使用它

下列指令不正确的是______.

A MOV BX, 3100H

B MOV [BX], 3100H

C MOV BX, [3100H]

( ) MOV [BX], [3100H]

下面关于Cache的叙述，错误的是

A 高速缓冲存储器简称Cache

B Cache处于主存与CPU之间

C Cache的速度远比CPU的速度慢

( ) 程序访问的局部性为Cache的引入提供了理论依据

以下部件不属于计算机控制器的部件是_____.

A 程序状态字寄存器

B 算术逻辑单元

C 程序计数器

( ) 指令寄存器

以下常见硬盘驱动器接口，错误的是

A SCSI

B ISA

C IDE

( ) SAA

以下对通用寄存器的描述，正确的是_____.

A DX常用于乘除指令数据运算

B BX中不能存放地址数据

C CX可以存放32位数据

( ) AX只能存放8位二进制数

以下硬盘的技术指标内容，错误的是

A 转速

B 传输率

C 平均寻道时间

( ) 厚度

用晶体管作为电子器件制成的计算机属于

A 第三代

B 第二代

C 第一代

( ) 第四代

运算器虽有许多部件组成，但其核心部分是_____.

A 算术/逻辑单元

B 数据总线

C 多路开关

( ) 通用寄存器

在CPU中，控制器的功能是

A 分析指令并发出相应的控制信号

B 只控制CPU的工作

C 进行算术运算

( ) 进行逻辑运算

在数据传送方式中，DMA方式与中断方式相比，主要优点是______.

A 传送程序简单

B CPU可分时工作

C 传送速度快

( ) CPU不必查询I/O口的状态

指令MOV AX，[BX]的源操作数位于______。

A 外设端口

B 通用寄存器

C 专用寄存器

( ) 内存单元

指令MUL BX执行后，乘积_____.

A 高16位放在AX中

B 低16位放在DX中

C 低16位放在BX中

( ) 高16位放在DX中

指令OU 30H,AL中30H是指______.

A 立即数

B 内存单元

C 寄存器

( )外设端口

中央处理器是指______.

A 控制器

B 运算控制器和主存储器

C 运算器和控制器

( ) 运算器

主存储器与CPU之间增加Cache的目的是______.

A 增大CPU的访问空间

B 增大CPU寄存器的数量

C 解决CPU与主存间的速度匹配问题

( ) 扩大主存储器的容量

论述题

请描述CPU相应外部中断的过程，并分析为什么 8086 中断向量表的大小是 1024 个字节？

请描述计算机中存储系统的层次结构，并分析分析存储系统的优势。

试述8259A中断响应过程？

答案

单选题

-5DB( ) 6--10CACCA

-15DADCB 16--20BADBA

-25AD( ) 26C 27C

论述题

"当CPU在INR引脚上接受一个高电平的中断请求信号并且当前的中断允许标志为1，CPU就会在当前指令执行完后开始响应外部的中断请求，具体如下：

从数据总线上读取外设送来的中断类型码，将其存入内部暂存器中;

将标志寄存器的值推入堆栈;

将标志寄存器中I 和清零;

将断点保护到堆栈中;

根据中断类型获取中断向量转入中断处理子程序;

处理完后恢复现场。

中断向量就是中断服务程序的入口地址。中断向量表存放中断服务程序的入口地址，或者存放跳转到中断服务程序入口的转移指令。8086 的中断向量表位于 RAM 区的0000H~003H。因为8086 支持 256 个中断，每个中断服务程序的入口地址是 4 个字节，共需要 1024字节。"

"所谓存储系统的层次结构，就是把各种不同存储容存取速度和价格的存储器按层次结构组成多层存储器，并通过管理软件和辅助硬件有机组合成统一的整体，使所存放的程序和数据按层次分布在各种存储器中。目前，在计算机系统中通常采用三级层次结构来构成存储系统，主要由高速缓冲存储器Cach主存储器和辅助存储器组成。

存储系统多级层次结构中，由上向下分三级，其容量逐渐增大，速度逐级降低，成本则逐次减少。整个结构又可以看成两个层次：它们分别是主存一辅存层次和cache一主存层次。这个层次系统中的每一种存储器都不再是孤立的存储器，而是一个有机的整体。它们在辅助硬件和计算机操作系统的管理下，可把主存一辅存层次作为一个存储整体，形成的可寻址存储空间比主存储器空间大得多。由于辅存容量大，价格低，使得存储系统的整体平均价格降低。由于Cache的存取速度可以和CPU的工作速度相媲美，故cache一主存层次可以缩小主存和cPu之间的速度差距，从整体上提高存储器系统的存取速度。尽管Cache成本高，但由于容量较小，故不会使存储系统的整体价格增加很多。

综上所述，一个较大的存储系统是由各种不同类型的存储设备构成，是一个具有多级层次结构的存储系统。该系统既有与CPU相近的速度，又有极大的容量，而成本又是较低的。其中高速缓存解决了存储系统的速度问题，辅助存储器则解决了存储系统的容量问题。采用多级层次结构的存储器系统可以有效的解决存储器的速容量和价格之间的矛盾。"

"当有外部中断请求时，8259A处理过程如下:

( )中断请求寄存器IRR接受外部中断请求并锁存，当中断屏蔽寄存器IMR为0时，则中断请求进入优先权判别器PR，由PR判断是否当前优先权最高？

 如果是，则8259A的IN为1，向CPU的INR发出中断请求；

( )当CPU的中断允许标志I=1，CPU响应中断，发回INA*信号；8259A使中断服务寄存器ISR的相应位置1，并将中断请求寄存器IRR的相应位清零，收到第二个INA*信号时，8259A送出中断类型码到数据总线；

( )若允许中断嵌套，则由8259A的PR依据ISR中的状态，判断新的中断请求优先权是否高于正在服务的中断。若是，则送出IN=1，向CPU的INR发中断请求信号，从而实现中断嵌套。

( )当中断服务结束时，CPU送出中断结束命令，使8259A清除ISR的相应位，从而结束一个中断服务。"