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数字电子电路
00073147
问题: 1. 十进制数（127.0625）
选项:
• A. （11101.101）
• B. （1111111.0001）
• C. （1011101.0011）
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问题: 2. 将二进制数（101011.101101）
选项:
• A. （45.839844）
• B. （44.839125）
• C. （43.703125）
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问题: 3. 将二进制数（100110.100111）
选项:
• A. （26.9C）
• B. （92.97）
• C. （46.47）
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问题: 4. 经证明，等式（ ）正确。
选项:
• A.
• B.
• C.
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问题: 5. 在下列真值表中，A、B为输入逻辑值，（ ）列的输出结果有误。
A
B
选项:
• A.
• B.
• C.
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问题: 6. 题图所示电路能够实现（ ）逻辑关系。
选项:
• A. 与
• B. 或
• C. 与或非
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问题: 7. 对于TTL电路，0.7V的输入电压为（ ）输入。
选项:
• A. 高电平
• B. 低电平
• C. 不能确定
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问题: 8. 在门电路的电气特性中，将输出电压急剧上升或下降所对应的（ ）称为阈值电压。
选项:
• A. 输入电压
• B. 输出电压
• C. 开启电压
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问题: 9. 对于TTL电路，当本级门电路输出高电平时，输出端电流（ ）。
选项:
• A. 向外流出，电路带拉电流负载
• B. 向内流入，电路带灌电流负载
• C. 不确定
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问题: 10. OC门“线与”连接并正常工作的前提是（ ）。
选项:
• A. 电路输出端只需一个外接负载电阻
• B. 每个OC门分别接一个负载电阻
• C. 电路输出端需要外接电源
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问题: 11. CMOS电路多余输入端（ ）。
选项:
• A. 能悬空
• B. 不能悬空
• C. 不确定
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问题: 12. 题图所示逻辑电路逻辑关系是（ ）。
选项:
• A.
• B.
• C.
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问题: 13. 将十进制小数转换成其他进制数时，应把小数部分乘以新进制的基数（如二进制的基数为2），把得到的整数部分作为新进制小数部分的最低位。（ ）
选项:
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问题: 14. 逻辑函数可以用真值表、逻辑表达式和逻辑电路图来表示，也可以用卡诺图表示，但卡诺图与其他形式不能相互转换。（ ）
选项:
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问题: 15. 波形图用于反映逻辑变量之间随时间变化的规律，能够方便直观地表现输入变量的逻辑关系。（ ）
选项:
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问题: 16. 门电路的带负载能力用扇出系数表示，它通常由门电路输出低电平时的带负载能力决定。（ ）
选项:
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问题: 17. 三态门是能够实现“线与”的逻辑门，当它处于高阻态时，输出端与电路连接断开。（ ）
选项:
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问题: 18. CMOS门电路在输入端和输出端的反相器，起到缓冲隔离和规范逻辑电平的作用。（ ）
选项:
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问题: 19. CMOS反相器的噪声容限大于TTL门电路的噪声容限，所以抗干扰能力也比TTL电路强。（ ）
选项:
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问题: 20. CMOS电路多余输入端不能悬空，TTL门电路的多余输入端可以悬空，悬空端相当于逻辑高电平。（ ）
选项:
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问题: 21. （1）根据题意列出真值表，正确结果为（ ）；
A
B
C
F
0
0
0
0
0
0
1
0
0
1
0
0
0
1
1
0
1
0
0
0
1
0
1
0
1
1
0
0
1
1
1
1
(a)
A
B
C
F
0
0
0
0
0
0
1
0
0
1
0
0
0
1
1
1
1
0
0
0
1
0
1
1
1
1
0
1
1
1
1
1
(b)
A
B
C
F
0
0
0
0
0
0
1
0
0
1
0
0
0
1
1
0
1
0
0
0
1
0
1
1
1
1
0
1
1
1
1
1
(c)
选项:
• A. 真值表（a）
• B. 真值表（b）
• C. 真值表（c）
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问题: 22. （2）按最小项列出正确的逻辑表达式为（ ）；
选项:
• A.
• B.
• C.
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问题: 23. （3）正确是最简逻辑表达式为（ ）。
选项:
• A.
• B.
• C.
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问题: 24. （1）该电路为一个门电路连接较多门电路作为负载的结构形式，该电路应该优先选用（ ）；
选项:
• A. TTL门电路
• B. CMOS门电路
• C. 两者均可
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问题: 25. （2）该电路以静态工作状态为主，若考虑功耗因素应选用（ ）。
选项:
• A. TTL门电路
• B. CMOS门电路
• C. 两者均可
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问题: 1. 由组合逻辑电路的功能特点可知，任意时刻电路的输出( )。
选项:
• A. 仅取决于该时刻的输入状态
• B. 仅取决于电路过去的输出状态
• C. 与该时刻输入状态和电路过去的输出状态均有关
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问题: 2. 下列消除竞争冒险的方法中，( )是错的。
选项:
• A. 在逻辑设计时增加冗余项
• B. 接入滤波电容
• C. 引入时钟脉冲
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问题: 3. 普通二进制编码器的输入变量中，任何时刻( )。
选项:
• A. 均可多个被编对象有输入，它们共同确定编码结果
• B. 均可多个被编对象有输入，但只对优先级别最高的进行编码
• C. 仅有一个被编对象有输入，其他均没有输入
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问题: 4. 三位同学按“少数服从多数”原则设计表决器逻辑电路，下列电路中（ ）是错误的。
选项:
• A. 图（a）
• B. 图（b）
• C. 图（c）
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问题: 5. 下列三个逻辑电路框图中，（ ）是译码器。
选项:
• A. 图a
• B. 图b
• C. 图c
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问题: 6. 由时序逻辑电路的功能特点可知，任意时刻触发器电路的输出状态( )。
选项:
• A. 仅取决于电路的输入信号
• B. 仅取决于现在的输出状态
• C. 不仅取决于输入信号，还与输入信号作用前的现态有关
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问题: 7. 由RS触发器的真值表可知，它的状态方程和约束条件是（ ）。
R
S
选项:
• A.
• B.
• C.
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问题: 8. 为了把串行输入的数据转换成并行输出的数据，可以使用( )。
选项:
• A. 计数器
• B. 移位寄存器
• C. 数据选择器
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问题: 9. 与同步时序电路相比，异步时序电路的主要缺点是( )。
选项:
• A. 抗干扰能力差
• B. 功耗大
• C. 速度慢
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问题: 10. N个触发器可以构成最大计数长度为( )的计数器。
选项:
• A. N
• B. N
• C. 2
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问题: 11. 组合逻辑电路符合逻辑关系的最简电路形式不会发生竞争冒险现象。( )
选项:
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问题: 12. 多位数值比较器在比较两个多位数的大小时，遵循先低位比较后高位的比较原则，只有在低位相等时，才需要比较高位。
选项:
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问题: 13. CMOS结构的组合逻辑越来越多被采用，是因为CMOS电路耗电量低。（ ）
选项:
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问题: 14. 若系统中既有数字电路也有模拟电路，印刷电路板应分别设置接地线再合并接地。（ ）
选项:
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问题: 15. 触发器虽然也是由门电路构成，但它与组合逻辑电路不同，具有逻辑状态的记忆功能。( )
选项:
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问题: 16. 将主从JK触发器的J和K端都接低电平，则在时钟脉冲CP的作用下特性方程应为。
选项:
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问题: 17. 当D触发器的现态
选项:
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问题: 18. 由M进制集成计数器构成N进制计数器，当M＜N时一般采用清零法或置位法，当M＞N时则适合采用级联法。（ ）
选项:
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问题: 19. （1）该电路最简与或形式的逻辑表达式是（ ）。
选项:
• A.
• B.
• C.
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问题: 20. （2）经分析，该电路具有（ ）功能。
选项:
• A. 表决
• B. 单、双数判断
• C. 四舍五入
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问题: 21. 分析图2-4所示电路的逻辑功能。在下列选项中选择正确答案填入空内。
选项:
• A. 下降沿触发的边沿JK触发器
• B. 上升沿触发的边沿JK触发器
• C. 主从JK触发器
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问题: 22. （2）分析可知，该电路为（ ）。
选项:
• A. 状态图如图2-5（a）所示，不能自启动五进制同步计数器，
• B. 状态图如图2-5（b）所示，能自启动五进制同步计数器，
• C. 状态图如图2-5（c）所示，能自启动六进制同步计数器，
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问题: 23. （3）在CP脉冲的作用下，该电路时序图为（ ）。
选项:
• A. 图2-6（a）
• B. 图2-6（b）
• C. 图2-6（c）
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